Steigende-/Fallende Flanke - LabVIEWForum.de

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Steigende-/Fallende Flanke

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02.09.2008, 19:56

Beitrag #1

R.B.

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Deutschland

Steigende-/Fallende Flanke

Hallo zusammen,

weiss einer wie ich ein FPGA Port Pin auf Steigende-/ bzw. Fallende Flanke prüfen kann?
In VHDL geht es mit rising_edge(PININ).

Danke

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Steigende-/Fallende Flanke - R.B. - 02.09.2008 19:56

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