INFO: Dieses Forum nutzt Cookies...
Cookies sind für den Betrieb des Forums unverzichtbar. Mit der Nutzung des Forums erklärst Du dich damit einverstanden, dass wir Cookies verwenden.

Es wird in jedem Fall ein Cookie gesetzt um diesen Hinweis nicht mehr zu erhalten. Desweiteren setzen wir Google Adsense und Google Analytics ein.


Antwort schreiben 

FPGA Xflow Error Code 6



Wenn dein Problem oder deine Frage geklärt worden ist, markiere den Beitrag als "Lösung",
indem du auf den "Lösung" Button rechts unter dem entsprechenden Beitrag klickst. Vielen Dank!

15.02.2011, 12:20 (Dieser Beitrag wurde zuletzt bearbeitet: 15.02.2011 12:21 von Nilbog.)
Beitrag #2

Nilbog Offline
LVF-Neueinsteiger


Beiträge: 8
Registriert seit: Oct 2010

2009
2008
en


Deutschland
RE: FPGA Xflow Error Code 6
Hallo,

das Problem kenne ich nicht und eine "so alte LV Version" hatte ich auch nicht bei der Hand, aber fallende Flanken kannst du einfach wie im angehängten 2009 Snippet angedeutet detektieren. Wiederkehrende Funktionsinhalte auf falling Edges könntest du im True-case der Case-Struktur abarbeiten, bzw. wie auch im Snippet angedeutet die Schleife sich beenden lassen bei einer falling edge. Das würde dann meines Erachtens nach dem Verhalten Waiting on falling Edge entsprechen.

Gruß

   
Alle Beiträge dieses Benutzers finden
Diese Nachricht in einer Antwort zitieren to top
Antwort schreiben 


Nachrichten in diesem Thema
FPGA Xflow Error Code 6 - der_hobel - 10.02.2011, 07:45
RE: FPGA Xflow Error Code 6 - Nilbog - 15.02.2011 12:20

Möglicherweise verwandte Themen...
Themen Verfasser Antworten Views Letzter Beitrag
  Error 61055 bei FPGA Kompilierung Woodeye 2 1.678 19.01.2024 11:15
Letzter Beitrag: Woodeye
  Sind Referenzen auf FPGA-Variablen in FPGA vi möglich? Felix777 2 7.617 26.10.2015 20:41
Letzter Beitrag: Felix777
  FPGA-Referenz öffnen: FPGA-VI nicht kompiliert LauraP. 9 12.376 17.03.2015 16:58
Letzter Beitrag: LauraP.
  FPGA mit realer IO simulieren - Error -61159 skar 3 5.929 26.08.2014 15:54
Letzter Beitrag: skar
  Fehlersuche bei FPGA-Code mit cRIO Mietzekatze 8 8.313 10.09.2013 18:52
Letzter Beitrag: Mietzekatze
  Pack-Error FPGA zu Klein: Wie optimieren? RobertR 8 7.924 13.01.2012 15:17
Letzter Beitrag: eb

Gehe zu: