Zeitverzögerung zwischen parallelen Schleifen - ungewollt!

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Zeitverzögerung zwischen parallelen Schleifen - ungewollt!

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11.07.2012, 09:03

Beitrag #3

GerdW

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RE: Zeitverzögerung zwischen parallelen Schleifen - ungewollt!

Hallo,

Wenn es der FPGA sein muss:
- ich würde die "Häuser" zusammenfassen, der FPGA kann bequem mit INTs rechnen und auf Byte-Ports der DO-Karte schreiben ("DO0-7" z.B.).

Ansonsten:
Mach doch das Ganze direkt auf dem cRIO. Das ist mehr als schnell genug für Temperaturregelung - und deutlich einfacher zu debuggen...

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Zeitverzögerung zwischen parallelen Schleifen - ungewollt! - Harry Hirsch - 10.07.2012, 13:46

RE: Zeitverzögerung zwischen parallelen Schleifen - ungewollt! - chrissyPu - 11.07.2012, 08:30

RE: Zeitverzögerung zwischen parallelen Schleifen - ungewollt! - Harry Hirsch - 11.07.2012, 12:03

RE: Zeitverzögerung zwischen parallelen Schleifen - ungewollt! - chrissyPu - 12.07.2012, 12:05

RE: Zeitverzögerung zwischen parallelen Schleifen - ungewollt! - Harry Hirsch - 13.07.2012, 09:21

RE: Zeitverzögerung zwischen parallelen Schleifen - ungewollt! - GerdW - 11.07.2012 09:03

RE: Zeitverzögerung zwischen parallelen Schleifen - ungewollt! - eb - 11.07.2012, 13:50

RE: Zeitverzögerung zwischen parallelen Schleifen - ungewollt! - Harry Hirsch - 11.07.2012, 15:21

RE: Zeitverzögerung zwischen parallelen Schleifen - ungewollt! - Harry Hirsch - 12.07.2012, 11:49

RE: Zeitverzögerung zwischen parallelen Schleifen - ungewollt! - Harry Hirsch - 13.07.2012, 11:23

RE: Zeitverzögerung zwischen parallelen Schleifen - ungewollt! - Harry Hirsch - 18.07.2012, 11:36

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