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Drahtbrucherkennung bei Digitalen Ausgängen



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09.04.2018, 10:28
Beitrag #1

MRL2018 Offline
LVF-Grünschnabel
*


Beiträge: 26
Registriert seit: Mar 2018

2014
2017
DE



Drahtbrucherkennung bei Digitalen Ausgängen
Hallo

Kann ich bei digitalen Ausgängen z.B. NI 6722 p 0.0 für die Drahtbrucherkennung mein Low-State auf einen Spannungswert legen, welche ca. der Hälfte des Highsignales entspricht?
Kann ich an der boolschen Ausgabe überhaupt manipulieren?
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09.04.2018, 10:38
Beitrag #2

GerdW Offline
______________
LVF-Team

Beiträge: 17.425
Registriert seit: May 2009

LV2021
1995
DE_EN

10×××
Deutschland
RE: Drahtbrucherkennung bei Digitalen Ausgängen
Hallo MRL,

Zitat:Kann ich bei digitalen Ausgängen … mein Low-State auf einen Spannungswert legen, welche ca. der Hälfte des Highsignales entspricht?
Nein.
(Bei der Hälfte des HIGH-Pegels liegt der "verbotene" Bereich für TTL/CMOS-Signale, der tunlichst vermieden werden sollte.)

Zitat:Kann ich an der boolschen Ausgabe überhaupt manipulieren?
Intern/softwaretechnisch: nein.
Extern durch zusätzliche Hardware: ja.

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