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Dieses Thema hat akzeptierte Lösungen:

Beliebiges Signal im FPGA.vi generieren



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24.08.2011, 20:41
Beitrag #3

chrissyPu Offline
LVF-Stammgast
***


Beiträge: 467
Registriert seit: Jun 2006

2014 PDS
2006
DE_EN

64283
Deutschland
RE: Beliebiges Signal im FPGA.vi generieren

Akzeptierte Lösung

Hi,

geht folgendermaßen:
- Speicherbereich auf FPGA definieren
- Diesen Bereich mit dem Signal füllen, das man haben möchte (über DMA am einfachsten)
- Speicherbereich je nach gewünschter Geschwindigkeit ausgeben

Damit hast Du einen Arbitrary Signal Generator und ich meine, da gibt's auch was im Examplefinder...

Grüße,

ch
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RE: Beliebiges Signal im FPGA.vi generieren - chrissyPu - 24.08.2011 20:41

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