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FPGA Counter mit 40MHz Takt



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21.09.2020, 10:53
Beitrag #4

GerdW Offline
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RE: FPGA Counter mit 40MHz Takt
Hallo Stephan,

zum VHDL kann ich nicht viel beitragen, aber etwas zum FPGA-VI:
- Warum kein NOT statt des Select-RubeGoldbergs?
- Was passiert, wenn der Ausgang des CLIPs über ein weiteres Schieberegister an den DO weitergeleitet wird? (Pipelining!)

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Nachrichten in diesem Thema
RE: FPGA Counter mit 40MHz Takt - GerdW - 18.09.2020, 09:50
RE: FPGA Counter mit 40MHz Takt - jg - 21.09.2020, 14:41
RE: FPGA Counter mit 40MHz Takt - GerdW - 21.09.2020 10:53

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